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组件封装式PQFP（Plastic Quad Flat Package塑料四方扁平包装）这种封装的芯片引脚之间的距离很小，管脚很细，一般大规模或超大集成电路都采用这种封装形式，其引脚一般在100个以上。然而，如果这些设计没有使用正确的材料和几何形状，微孔可能会经历意想不到的开裂和分层。用这种形式封装的芯片必须采用***D（表面安装设备技术）将芯片与主板焊接起来。采用***D安装的芯片不必在主板上打孔，一般在主板表面上有设计好的响应管脚的焊点。将芯片各脚对准相应的焊点，即可实现与主板的焊接。用这种方法焊上去的芯片，如果不用工具很难拆卸下来。

封装测试的竞争力：
由于封测是半导体制造的后道工序，所以并非是产业链的核心。其技术可分为传统封装和***封装，气派科技，采用的是传统封装技术。

***封装技术的特征是封装小型化、模型化、高密度和高可靠，主要用于计算和通信领域的逻辑器件和存储芯片的封测，进一步渗透到移动领域的模拟和射频市场，成长空间大，是未来技术发展的主要方向。

人们对芯片级封装还没有一个统一的定义，有的公司将封装本体面积与芯片面积之比小于2的定为CSP，而有的公司将封装本体面积与芯片面积之比小于1.4或1.2的定为CSP。CIS封装测试行业驱动因素：这里主要指的是CSP封装形式的CIS封装，行业增长因素主要来自于800万像素以下低像素摄像头颗数的增长。WLCSP生产周期和成本大幅下降，芯片所需引脚数减少，提高了集成度；引脚产生的电磁干扰几乎被消除，采用此封装的内存可以支持到800MHz的频率，容量可达1GB，所以它号称是未来封装的主流。它的不足之处是芯片得不到足够的保护。半导体器件有许多封装形式，按封装的外形、尺寸、结构分类可分为引脚插入型、表面贴装型和封装三类。从DIP、SOP、QFP、PGA、BGA到CSP再到SIP，技术指标一代比一代***。

所谓封装测试其实就是封装后测试,把已制造完成的半导体元件进行结构及电气功能的确认，以保证半导体元件符合系统的需求的过程称为封装后测试。此外，这种封装技术的聚合物层末端靠近裸片边缘，因为热膨胀系数（CTE）失匹，这个区域会出现附加的残余应力。WLCSP有着更明显的优势：是工艺大大优化，晶圆直接进入封装工序，而传统工艺在封装之前还要对晶圆进行切割、分类；所有集成电路一次封装，刻印工作直接在晶圆上进行，设备测试一次完成，有别于传统组装工艺。Dual此封装形式的特点是引脚全部在两边，而且引脚的数量不算多。它的封装形式比较多，又可细分为SOT、SOP、SOJ、SSOP、HSOP及其他。